[爆卦]CMOS NAND是什麼?優點缺點精華區懶人包

為什麼這篇CMOS NAND鄉民發文收入到精華區:因為在CMOS NAND這個討論話題中,有許多相關的文章在討論,這篇最有參考價值!作者Cartel117 (等著領便當的人)看板Electronics標題[問題] 為什麼NAND會比...


如提
希望有人可以幫我解決一下問題
thx~~~^^

--
※ 發信站: 批踢踢實業坊(ptt.cc)
◆ From: 140.138.144.115
espreesso:CE就相阿 09/22 20:23
espreesso:CS 09/22 20:23
cccchaha:好像是CMOS實現起來比較容易快速又省錢 09/22 20:32
moonls:什麼是cs相 ? 09/22 22:27
DennisKao:CS = Common Sourse? 09/23 17:50

> -------------------------------------------------------------------------- <

作者: jubel (爆體重,爆長相...) 看板: Electronics
標題: Re: [問題] 為什麼NAND會比AND常使用?
時間: Thu Sep 22 18:05:59 2005

※ 引述《Cartel117 (等著領便當的人)》之銘言:
: 如提
: 希望有人可以幫我解決一下問題
: thx~~~^^

以前老師說過
因為反相的好用
只要NAND就可以兜出所有的邏輯閘


--
┌─┐┌─┐┌─┐┌─┐┌─┐┌─┐┌─┐┌─┐┌─┐┌─┐┌─┐┌─┐┌─┐
│一││一││一││二││三││四││五││六││七││八││九││九││九│
│萬││萬││萬││萬││萬││萬││萬││萬││萬││萬││萬││萬││萬│
└─┘└─┘└─┘└─┘└─┘└─┘└─┘└─┘└─┘└─┘└─┘└─┘└─┘

--
※ 發信站: 批踢踢實業坊(ptt.cc)
◆ From: 59.120.113.157
※ 編輯: jubel 來自: 59.120.113.157 (09/22 18:10)
Seiya:恩~NAND是萬用閘 09/22 20:31

> -------------------------------------------------------------------------- <

發信人: [email protected] (andy), 看板: Electronics
標 題: Re: [問題] 為什麼NAND會比AND常使用?
發信站: 交大資科_BBS (Thu Sep 22 20:44:03 2005)
轉信站: ptt!ctu-reader!ctu-peer!news.nctu!news.cis.nctu!cis_nctu

==> 在 [email protected] (等著領便當的人) 的文章中提到:
> 如提
> 希望有人可以幫我解決一下問題
> thx~~~^^

cmos cell

and = nand + inv

nand 比較小
--
* Origin: ★ 交通大學資訊科學系 BBS ★ <bbs.cis.nctu.edu.tw: 140.113.23.3>
moonls:inv也是用nand完成 09/22 22:26

> -------------------------------------------------------------------------- <

發信人: [email protected] (我是熱臉貼冷屁股), 看板: Electronics
標 題: Re: [問題] 為什麼NAND會比AND常使用?
發信站: 朝陽向日葵BBS (Fri Sep 23 01:43:46 2005)
轉信站: ptt!ctu-reader!ctu-peer!news.nctu!news.nchu!SunFlower

※ 引述《[email protected] (andy)》之銘言:
> ==> 在 [email protected] (等著領便當的人) 的文章中提到:
> > 如提
> > 希望有人可以幫我解決一下問題
> > thx~~~^^
> cmos cell
> and = nand + inv
> nand 比較小


CMOS電路中 ,
因為PMOS和NMOS的充放電特性關係 ,
電路輸出之訊號剛好是反相的 ,
所以若不計AO電路的話 ,
一般電路多是以INV, NAND, NOR為基本元件 (稱之為負邏輯元件) ,

如果你真要直接做AND等正邏輯元件 ,
主要有以下兩個方法 :

1. 輸出端加Inverter,
會多出Inverter的delay time ...
可以參考Domino電路 ... 多是用正邏輯的 ...

2. 把NMOS當pull-up元件 , PMOS當pull-down元件 ,
不過沒啥人會這麼做 ...
因為輸出電壓是non-full swing ...
除了會增加下一級的evaluation delay外 ,
也容易使下一級有leakage current ...

所以...乖乖的用negative logic接才方便 ...




--
※ Origin: 向 日 葵 <bbs.im.cyut.edu.tw>
◆ From: 140.112.217.12

你可能也想看看

搜尋相關網站