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Verilator 是一个高性能Verilog HDL 模拟器与lint 系统 - Gitee

Verilator 是一个高性能Verilog HDL 模拟器与lint 系统，用户编写一个小的C++/SystemC 封装文件，该文件实例化用户顶层模块的“已验证”模型.

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