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三態邏輯- 維基百科，自由的百科全書

在數位電路中，三態邏輯（英語：Three-state logic）允許輸出端在0和1兩種邏輯電平之外呈現高阻態，等效於將輸出的影響從後級電路中移除。這允許多個電路共同使用同 ...

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