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[問題求助] verilog 浮點數運算疑問- FPGA/CPLD/ASIC討論區

想請問有設計過IEEE 754 浮點數規則的程式的大大.....規則小弟是看的懂,不過疑問處在於假設我設計一個簡單的浮點數加法器,輸入數值a跟b相加.

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