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Verilog设计遇到了Congestion问题怎么办？ - 集成电路 - E课网

Congestion意思为拥塞，一般是在后端PR阶段发现布局布线比较拥挤，可能会导致布线布不过去，出问题也无法做ECO。 Congestion也分为几种情况，和前端密切相关的 ...

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