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chip die差異
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http://www.naipo.com/Portals/1/web_tw/Knowledge_Center/Research_Development/publish-131.htm
散出型晶圓級構裝(Fan-Out WLP)之技術與挑戰
將測試良好的晶片(Know Good Die; KGD)翻轉朝下,黏貼於載具(Carrier)上,在載具上晶片與晶片的距離,定義了Fan-Out的面積,並且可自由選擇晶片距離。
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