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verilog基础：单if语句、多if语句和case语句之间的优先级关系

综合出来的电路有优先级，从电路的角度来说，单if 语句综合出来的电路类似于数据选择器，else 路选通的条件是前面所有的if 条件都不满足。 always@(*) ...

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