請問大家在compile Verilog還有simulate都是用哪個軟體阿?
因為之前在學AHDL的時候都是用Max Plus II
然後記得Verilog也可以用Max Plus II來編輯 & compile & simulate
現在想重新複習一下...
所以想請教一下大家都是用哪個軟體玩的^^

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發信人: [email protected] (漫天回憶舞秋風), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 清華資訊(楓橋驛站) (Wed Jun 29 18:58:14 2005)
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※ 引述《[email protected] (PO文賺P幣)》之銘言：
> 請問大家在compile Verilog還有simulate都是用哪個軟體阿?
> 因為之前在學AHDL的時候都是用Max Plus II
> 然後記得Verilog也可以用Max Plus II來編輯 & compile & simulate
> 現在想重新複習一下...
> 所以想請教一下大家都是用哪個軟體玩的^^

modelsim

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作者: trela (PO文賺P幣) 看板: Electronics
標題: Re: [問題] 請問一下VERILOG的問題
時間: Wed Jun 29 20:27:11 2005

※ 引述《[email protected] (漫天回憶舞秋風)》之銘言：
: ※ 引述《[email protected] (PO文賺P幣)》之銘言：
: > 請問大家在compile Verilog還有simulate都是用哪個軟體阿?
: > 因為之前在學AHDL的時候都是用Max Plus II
: > 然後記得Verilog也可以用Max Plus II來編輯 & compile & simulate
: > 現在想重新複習一下...
: > 所以想請教一下大家都是用哪個軟體玩的^^
: modelsim
請問是業界都用這套嗎....
怎麼好像大部分的學校都是用MAX PLUS II在上課阿><

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發信人: [email protected] (漫天回憶舞秋風), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 清華資訊(楓橋驛站) (Thu Jun 30 11:40:08 2005)
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※ 引述《[email protected] (PO文賺P幣)》之銘言：
> ※ 引述《[email protected] (漫天回憶舞秋風)》之銘言：
> : modelsim
> 請問是業界都用這套嗎....
> 怎麼好像大部分的學校都是用MAX PLUS II在上課阿><

業界大多用工作站吧, modelsim 只適合初期個人發展 rtl 階段的 function
驗證而已, 不過對一般學生來說應該都很夠用了.
--
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發信人: John Doe <[email protected]>, 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: (null) (Thu Jun 30 22:10:15 2005)
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漫天回憶舞秋風 wrote:
> ※ 引述《[email protected] (PO文賺P幣)》之銘言：
>
>>※ 引述《[email protected] (漫天回憶舞秋風)》之銘言：
>>: modelsim
>>請問是業界都用這套嗎....
>>怎麼好像大部分的學校都是用MAX PLUS II在上課阿><
>
>
> 業界大多用工作站吧, modelsim 只適合初期個人發展 rtl 階段的 function
> 驗證而已, 不過對一般學生來說應該都很夠用了.
那是"學生版"。
modelsim是業界用的眾多verilog simulators之一

> -------------------------------------------------------------------------- <

發信人: [email protected] (這一年都是趕趕趕), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 不良牛牧場 (Fri Jul 1 18:51:12 2005)
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※ 引述《[email protected] (漫天回憶舞秋風)》之銘言：
: ※ 引述《[email protected] (PO文賺P幣)》之銘言：
: > 請問是業界都用這套嗎....
: > 怎麼好像大部分的學校都是用MAX PLUS II在上課阿><
: 業界大多用工作站吧, modelsim 只適合初期個人發展 rtl 階段的 function
: 驗證而已, 不過對一般學生來說應該都很夠用了.

呵呵...再來就是因為PC上就可以用
很方便
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發信人: [email protected] (永久ID.資工畢業真好), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 清華資訊(楓橋驛站) (Fri Jul 1 19:39:43 2005)
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※ 引述《boy0 (漫天回憶舞秋風)》之銘言：
> ※ 引述《[email protected] (PO文賺P幣)》之銘言：
> > 請問是業界都用這套嗎....
> > 怎麼好像大部分的學校都是用MAX PLUS II在上課阿><
> 業界大多用工作站吧, modelsim 只適合初期個人發展 rtl 階段的 function
> 驗證而已, 不過對一般學生來說應該都很夠用了.

要看公司大小. 像 VIA 就是在工作站作業.
不過小公司就用 modelsim了.
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發信人: [email protected] (漫天回憶舞秋風), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 清華資訊(楓橋驛站) (Fri Jul 1 21:48:23 2005)
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※ 引述《[email protected] (John Doe)》之銘言：
> 漫天回憶舞秋風 wrote:
> > 業界大多用工作站吧, modelsim 只適合初期個人發展 rtl 階段的 function
> > 驗證而已, 不過對一般學生來說應該都很夠用了.
> 那是"學生版"。
> modelsim是業界用的眾多verilog simulators之一

我不曉得 modelsim 有 for linux 的, 如果有, 那就恕我孤陋寡聞吧... XD
ModelSim 並不是 Mentor 不是推業界的主力, 像是工作站平臺 ldv 系列的
code coverage 功能很早就有了, modelsim 雖然也有, 不過那也是最近幾個
版本的事.
據我所知, 大部分公司很少在 project co-work 時是用 modelsim 當 simulator
的, 而且我也不知道 makefile 該怎麼寫... :P

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發信人: [email protected] (與電動有仇), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 中央資工二進位的世界 (Fri Jul 1 22:53:22 2005)
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※ 引述《[email protected] (漫天回憶舞秋風)》之銘言：
: ※ 引述《[email protected] (PO文賺P幣)》之銘言：
: > 請問是業界都用這套嗎....
: > 怎麼好像大部分的學校都是用MAX PLUS II在上課阿><
: 業界大多用工作站吧, modelsim 只適合初期個人發展 rtl 階段的 function
: 驗證而已, 不過對一般學生來說應該都很夠用了.
對學生有可能不夠用:P
尤其是修到IC Design的課，ㄏㄏ

--
〒作者：davidlin 來自：59-120-228-12.HINET-IP.hinet.net
◎二進位的世界【140.115.50.50‧binary.csie.ncu.edu.tw】

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發信人: [email protected] (與電動有仇), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 中央資工二進位的世界 (Fri Jul 1 22:57:20 2005)
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※ 引述《[email protected] (PO文賺P幣)》之銘言：
: ※ 引述《[email protected] (漫天回憶舞秋風)》之銘言：
: : modelsim
: 請問是業界都用這套嗎....
: 怎麼好像大部分的學校都是用MAX PLUS II在上課阿><
學校會用應該是因為Altera有免費學生版的軟體
當然也是為了他們公司未來賺錢之用XD

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發信人: [email protected] (這一年都是趕趕趕), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 不良牛牧場 (Fri Jul 1 23:23:02 2005)
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※ 引述《[email protected] (永久ID.資工畢業真好)》之銘言：
: ※ 引述《boy0 (漫天回憶舞秋風)》之銘言：
: > 業界大多用工作站吧, modelsim 只適合初期個人發展 rtl 階段的 function
: > 驗證而已, 不過對一般學生來說應該都很夠用了.
: 要看公司大小. 像 VIA 就是在工作站作業.
: 不過小公司就用 modelsim了.

很好奇
公司不用工作站很怪耶
總不會只寫寫code不合成、不P&R吧?
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發信人: [email protected] (bluerex), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 交大資科_BBS (Sat Jul 2 10:09:45 2005)
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modelsim有linux版,我用過....

==> 在 [email protected] (漫天回憶舞秋風) 的文章中提到:
> ※ 引述《[email protected] (John Doe)》之銘言：
> > 漫天回憶舞秋風 wrote:
> > 那是"學生版"。
> > modelsim是業界用的眾多verilog simulators之一
> 我不曉得 modelsim 有 for linux 的, 如果有, 那就恕我孤陋寡聞吧... XD
> ModelSim 並不是 Mentor 不是推業界的主力, 像是工作站平臺 ldv 系列的
> code coverage 功能很早就有了, modelsim 雖然也有, 不過那也是最近幾個
> 版本的事.
> 據我所知, 大部分公司很少在 project co-work 時是用 modelsim 當 simulator
> 的, 而且我也不知道 makefile 該怎麼寫... :P
--
* Origin: ★ 交通大學資訊科學系 BBS ★ <bbs.cis.nctu.edu.tw: 140.113.23.3>

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發信人: [email protected] (bluerex), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 交大資科_BBS (Sat Jul 2 10:11:43 2005)
轉信站: ptt!ctu-reader!ctu-peer!news.nctu!news.cis.nctu!cis_nctu

用PC+linux比工作站快多了,
很多EDA都會出Linux version,
因為對他們而言,移植在WS的SW到Linux 上比到Windows上快多了.

==> 在 [email protected] (這一年都是 的文章中提到:
> ※ 引述《[email protected] (永久ID.資工畢業真好)》之銘言：
> : 要看公司大小. 像 VIA 就是在工作站作業.
> : 不過小公司就用 modelsim了.
> 很好奇
> 公司不用工作站很怪耶
> 總不會只寫寫code不合成、不P&R吧?
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作者: bxxl (bool) 看板: Electronics
標題: Re: [問題] 請問一下VERILOG的問題
時間: Sat Jul 2 10:36:40 2005

※ 引述《[email protected] (bluerex)》之銘言：
: modelsim有linux版,我用過....
: ==> 在 [email protected] (漫天回憶舞秋風) 的文章中提到:
: > 我不曉得 modelsim 有 for linux 的, 如果有, 那就恕我孤陋寡聞吧... XD
: > ModelSim 並不是 Mentor 不是推業界的主力, 像是工作站平臺 ldv 系列的
: > code coverage 功能很早就有了, modelsim 雖然也有, 不過那也是最近幾個
: > 版本的事.
: > 據我所知, 大部分公司很少在 project co-work 時是用 modelsim 當 simulator
: > 的, 而且我也不知道 makefile 該怎麼寫... :P

我現在就是在PC上用 cygwin 跑 modelsim,
目前的project至少有10個人以上在co-work...

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◆ From: 59.120.57.250

> -------------------------------------------------------------------------- <

發信人: [email protected] (漫天回憶舞秋風), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 清華資訊(楓橋驛站) (Sat Jul 2 18:44:30 2005)
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※ 引述《[email protected] (bluerex)》之銘言：
> modelsim有linux版,我用過....
> ==> 在 [email protected] (漫天回憶舞秋風) 的文章中提到:
> > 我不曉得 modelsim 有 for linux 的, 如果有, 那就恕我孤陋寡聞吧... XD
> > ModelSim 並不是 Mentor 不是推業界的主力, 像是工作站平臺 ldv 系列的
> > code coverage 功能很早就有了, modelsim 雖然也有, 不過那也是最近幾個
> > 版本的事.
> > 據我所知, 大部分公司很少在 project co-work 時是用 modelsim 當 simulator
> > 的, 而且我也不知道 makefile 該怎麼寫... :P

先聲明, 我所指的"工作站"不見得是什麼 SunOS, 動輒幾十萬的昂貴機器,
敝公司財力不像鴻海, Intel, Motorola 這些爆發戶一樣,
隨便幾臺 PC 灌一灌 linux, 功能就跟真正的 "Work Station" 差不多了.
或許有人會反駁我, 然後洋洋灑灑列舉幾百樣差異處, 不過我不是 MIS,
對我來說, 不管好貓壞貓, 只要能讓我早點下班的機器就是好貓. :P

這幾年 Mentor 在新竹辦的 EDA 發表會我都有去吃點心 (而且都選在國賓,
能不能換家啊 ?) 就我兩年多以前用 pc 版的 ModelSim 的感覺來說, 並
沒有比較好用耶! 連要 dump fsdb 都不能直接 call, 做 code coverage
也沒辦法, 或許我拿的版本不是白金會員等級的, 所以要什麼都沒什麼,
如果是我誤會 ModelSim 的話, 那我下次點心會少吃點, 以示懺悔...

BTW, 無論是 synthesis run-time 或是合出來的結果, 聽說 BuildGate
都要比 S 牌的好, 公司同事稍微試了一下, 好像真有那麼回事. 有沒有
人願意分享一下經驗的 ? (Mentor 派來的打手就不必了, 謝謝)


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發信人: [email protected] (我什麼都不是), 看板: Electronics
標 題: Re: [問題] 請問一下VERILOG的問題
發信站: 清華資訊(楓橋驛站) (Tue Jul 5 20:56:36 2005)
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※ 引述《[email protected] (這一年都是趕趕趕)》之銘言：
> ※ 引述《[email protected] (永久ID.資工畢業真好)》之銘言：
> : 要看公司大小. 像 VIA 就是在工作站作業.
> : 不過小公司就用 modelsim了.
> 很好奇
> 公司不用工作站很怪耶
> 總不會只寫寫code不合成、不P&R吧?

因為我們公司是IC designer的都會有兩台電腦, 工作站跟PC.
為了要打混, coding都用PC.. 就可以用MSN,Explore..
P&R等後端部分尤其他專門人負責.
跑 gate-sim, post-sim時才用到工作站.
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