課名：積體電路設計導論
科號：11010EE 323000
老師：張孟凡
課本：以教授ppt為主
課別：電機系專業選修(語文、某系選修、某系必修、通識某向度)
學分：3
涼度：★(滿分五分，空心代表半分!請自行增減!)
甜度：★★★★

建議先修課程：電子學、電路學和邏輯設計

課程內容\簡介：

1. Introductions
2. CMOS Devices and IC Process
3. Inverter
4. Static and Dynamic CMOS Gates
5. Mos and Parasitic RC
6. Sequential Circuits
7. Memory
8. Challenge in Chip Design

上課方式：老師講授ppt

給分：
2 Midterm exams: 35% (1st: 20%, 2nd: 15%)
1 Final Exam: 15%
5 Homeworks (Labs): 30% (6% each)
1 Design Project (2 students per team): 20%

考試作業型態：

考試的部分盡量跟學長姊拿考古
這樣準備起來比較有頭緒 也需要熟讀他的ppt
會考某某電路怎麼畫 也要解釋電路的運作原理

以期末考為例 他有考PCM STT-MRAM ReRAM的LRS和HRS分別是什麼
這題其實考的蠻細的 好險我考試前有問學長姊考什麼


作業的部分給分蠻佛的 有做出來並且報告好好弄90-100不是問題
我這邊只說個大概每個作業要做什麼 實際上還需要寫報告分析...
有些作業會有bonus 需要依照老師的要求爬天梯 EX:FOM越小越好

HW1:
Do the simulation and analysis with cic018.l.
分別以hspice模擬inverter和inverter chain

HW2:
畫inverter chain和combination logic的layout
從這個作業開始都需要畫layout
畫完需要跑DRC LVS PEX
如果還是使用180nm製成 可以看這個影片學習layout的部分
https://www.youtube.com/watch?v=O0Z1ELxZV1E

HW3:
畫SR latch和D flip-flop的layout

HW4:
畫6to64decoder的layout
這個作業要好好做 期末project你不可能想重畫decoder

HW5:
畫Sense Amplifier的layout

Final project:
完成Rom Macro而且需要demo他的波形圖
會檢查DRC LVS 有沒有外灌訊號

每個作業給兩個星期做
全部作業最花時間的是decoder
真的要好好畫 因為project會用到 不然就要保佑你的隊友夠carry
Project要儘早開始 不然真的會需要熬好幾個晚上
那幾天電機系工作站蠻熱鬧的 切記工作站凌晨四點會重新開機

作業或project都是歷年稍微改一下 可以參考學長姐的家傳
幾乎都要重畫 因為會稍微改一下內容
EX:5to32decoder -> 6to64decoder



老師的喜好、個性：
老師人蠻好的 肚子真的蠻大的XD
教授在業界待一段時間 所以在課堂中都會分享業界小故事
我覺得這堂課精華就在這XD


給加簽嗎?
往年好像會給到教室滿為止
但今年因為疫情所以好像只給本系
第一堂課會勸退一些人 因為這堂課真的不輕鬆


補充:final project隊友好好選;)


總成績/班上排名：還沒公佈

成績:
成績分布：
↓每組人數
A+ % ( )
A % ( )
A- % ( )
B+ % ( )
B % ( )
B- % ( )
C+ % ( )
C % ( )
C- % ( )
D以下 % ( )


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你們要不要在一起= =
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